3,260
edits
Changes
m
→Introduction
** A = Analog signal
* Voltage: I/O voltage levels
==J1 odd pins (1 to 139)==
{| class="wikitable" {| {{table}}
| align="center" style="background:#f0f0f0;"|'''Pin'''
| align="center" style="background:#f0f0f0;"|'''Pin Name'''
| align="center" style="background:#f0f0f0;"|'''Internal Connections'''
| align="center" style="background:#f0f0f0;"|'''Ball/pin #'''
| align="center" style="background:#f0f0f0;"|'''Supply Group'''
| align="center" style="background:#f0f0f0;"|'''Type'''
| align="center" style="background:#f0f0f0;"|'''Voltage'''
| align="center" style="background:#f0f0f0;"|'''Note'''
|-
|-
|J1.1||DGND||DGND||n.a.||||||||
|-
|J1.3||IO_L7P_T1_AD2P_35||FPGA.IO_L7P_T1_AD2P_35||M19||||||||
|-
|J1.5||IO_L10P_T1_AD11P_35||FPGA.IO_L10P_T1_AD11P_35||K19||||||||
|-
|J1.7||IO_L11P_T1_SRCC_35||FPGA.IO_L11P_T1_SRCC_35||L16||||||||
|-
|J1.9||IO_L8N_T1_AD10N_35||FPGA.IO_L8N_T1_AD10N_35||M18||||||||
|-
|J1.11||IO_L7N_T1_AD2N_35||FPGA.IO_L7N_T1_AD2N_35||M20||||||||
|-
|J1.13||DGND||DGND||n.a.||||||||
|-
|J1.15||IO_L9P_T1_DQS_AD3P_35||FPGA.IO_L9P_T1_DQS_AD3P_35||L19||||||||
|-
|J1.17||IO_L9N_T1_DQS_AD3N_35||FPGA.IO_L9N_T1_DQS_AD3N_35||L20||||||||
|-
|J1.19||DGND||DGND||n.a.||||||||
|-
|J1.21||IO_L20P_T3_AD6P_35||FPGA.IO_L20P_T3_AD6P_35||K14||||||||
|-
|J1.23||IO_L20N_T3_AD6N_35||FPGA.IO_L20N_T3_AD6N_35||J14||||||||
|-
|J1.25||IO_L22P_T3_AD7P_35||FPGA.IO_L22P_T3_AD7P_35||L14||||||||
|-
|J1.27||IO_L12N_T1_MRCC_35||FPGA.IO_L12N_T1_MRCC_35||K18||||||||
|-
|J1.29||DGND||DGND||n.a.||||||||
|-
|J1.31||IO_L21P_T3_DQS_AD14P_35||FPGA.IO_L21P_T3_DQS_AD14P_35||N15||||||||
|-
|J1.33||IO_L21N_T3_DQS_AD14N_35||FPGA.IO_L21N_T3_DQS_AD14N_35||N16||||||||
|-
|J1.35||DGND||DGND||n.a.||||||||
|-
|J1.37||IO_L17N_T2_AD5N_35||FPGA.IO_L17N_T2_AD5N_35||H20||||||||
|-
|J1.39||IO_L13N_T2_MRCC_35||FPGA.IO_L13N_T2_MRCC_35||H17||||||||
|-
|J1.41||IO_L19P_T3_35||FPGA.IO_L19P_T3_35||H15||||||||
|-
|J1.43||IO_L18P_T2_AD13P_35||FPGA.IO_L18P_T2_AD13P_35||G19||||||||
|-
|J1.45||IO_L16P_T2_35||FPGA.IO_L16P_T2_35||G17||||||||
|-
|J1.47||IO_L15N_T2_DQS_AD12N_35||FPGA.IO_L15N_T2_DQS_AD12N_35||F20||||||||
|-
|J1.49||DGND||DGND||n.a.||||||||
|-
|J1.51||IO_L2N_T0_AD8N_35||FPGA.IO_L2N_T0_AD8N_35||A20||||||||
|-
|J1.53||IO_L1N_T0_AD0N_35||FPGA.IO_L1N_T0_AD0N_35||B20||||||||
|-
|J1.55||IO_L5N_T0_AD9N_35||FPGA.IO_L5N_T0_AD9N_35||E19||||||||
|-
|J1.57||IO_L5P_T0_AD9P_35||FPGA.IO_L5P_T0_AD9P_35||E18||||||||
|-
|J1.59||DGND||DGND||n.a.||||||||
|-
|J1.61||IO_L3P_T0_DQS_AD1P_35||FPGA.IO_L3P_T0_DQS_AD1P_35||E17||||||||
|-
|J1.63||IO_L3N_T0_DQS_AD1N_35||FPGA.IO_L3N_T0_DQS_AD1N_35||D18||||||||
|-
|J1.65||DGND||DGND||n.a.||||||||
|-
|J1.67||VDDIO_BANK35||FPGA.VCCO_35||C19 - F18 - H14 - J17 - K20 - M16||||||||
|-
|J1.69||XADC_AGND||FPGA.GNDADC_0||J10||||||||
|-
|J1.71||XADC_AGND||FPGA.GNDADC_0||J10||||||||
|-
|J1.73||PS_MIO33_501||CPU.PS_MIO33_501||D15||||||||
|-
|J1.75||PS_MIO32_501||CPU.PS_MIO32_501||A14||||||||
|-
|J1.77||PS_MIO31_501||CPU.PS_MIO31_501||E16||||||||
|-
|J1.79||PS_MIO30_501||CPU.PS_MIO30_501||C15||||||||
|-
|J1.81||PS_MIO29_501||CPU.PS_MIO29_501||C13||||||||
|-
|J1.83||DGND||DGND||n.a.||||||||
|-
|J1.85||PS_MIO28_501||CPU.PS_MIO28_501||C16||||||||
|-
|J1.87||ETH_MDIO||CPU.PS_MIO53_501 - LAN.MDIO||C11 - 37||||||||
|-
|J1.89||ETH_MDC||CPU.PS_MIO12_501||C10||||||||
|-
|J1.91||ETH_LED1||LAN.LED1 / PME_N1||17||||||||
|-
|J1.93||ETH_LED2||LAN.LED2||15||||||||
|-
|J1.95||DGND||DGND||n.a.||||||||
|-
|J1.97||ETH_TXRX1_M||LAN.TXRXM_B||6||||||||
|-
|J1.99||ETH_TXRX1_P||LAN.TXRXP_B||5||||||||
|-
|J1.101||DGND||DGND||n.a.||||||||
|-
|J1.103||ETH_TXRX0_M||LAN.TXRXM_A||3||||||||
|-
|J1.105||ETH_TXRX0_P||LAN.TXRXP_A||2||||||||
|-
|J1.107||DVDDH||LAN.DVDDH||17 - 34 - 39||||||||
|-
|J1.109||N.C.||Not Connected||n.a.||||||||
|-
|J1.111||USBOTG_CPEN||USB.CPEN||7||||||||
|-
|J1.113||OTG_VBUS||USB.OTG_VBUS||2||||||||
|-
|J1.115||OTG_ID||USB.ID||1||||||||
|-
|J1.117||DGND||DGND||n.a.||||||||
|-
|J1.119||SPI0_DQ3/MODE0/NAND_IO0||CPU.PS_MIO5_500||A6||||||||
|-
|J1.121||SPI0_DQ2/MODE2/NAND_IO2||CPU.PS_MIO4_500||B7||||||||
|-
|J1.123||SPI0_DQ1/MODE1/NAND_WE||CPU.PS_MIO3_500||D6||||||||
|-
|J1.125||SPI0_DQ0/MODE3/NAND_ALE||CPU.PS_MIO2_500||B8||||||||
|-
|J1.127||DGND||DGND||n.a.||||||||
|-
|J1.129||SPI0_SCLK/MODE4/NAND_IO1||CPU.PS_MIO6_500||A5||||||||
|-
|J1.131||NAND_BUSY||CPU.PS_MIO14_500||C5||||||||
|-
|J1.133||PS_MIO15_500||CPU.PS_MIO15_500||C8||||||||
|-
|J1.135||N.C.||Not Connected||n.a.||||||||
|-
|J1.137||MEM_WPN||NAND.WP - NOR.WP/IO2||19 - C4||||||||
|-
|J1.139||DGND||DGND||n.a.||||||||
|-
|}
==J1 even pins (2 to 140)==
==J2 odd pins (1 to 139)==
==J2 even pins (2 to 140)==
==J3 odd pins (1 to 139)==
==J3 even pins (2 to 140)==
